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power gatingの部分一致の例文一覧と使い方

該当件数 : 55件

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例文

To provide a semiconductor integrated circuit having a communication interface and characterized in that power consumption is reducible by eliminating a leak current by actualizing power gating by an easy method without following a special procedure.例文帳に追加

通信インタフェースを有する半導体集積回路において、特別な手順を踏むことなく極めて簡素な方法でパワーゲーティングを実現することによりリーク電流を排除し、消費電力を低減することができる半導体集積回路を提供する。 - 特許庁

A power gating module 200 includes a QPSK modulator 206, an up-converter 204 and an amplifier 210 and uses a signal from a router 204 for a transmission frame signal to transmit the signal to a downlink from a feed path 112 or 114 via a switch 110.例文帳に追加

電力ゲーティング・モジュール２００は、ＱＰＳＫ変調器２０６、アップ・コンバータ２０４及び増幅器２１０を含み、ルータ２０４からの信号を送信フレーム信号として、スイッチ１１０を介してフィード・パス１１２又は１１４からダウンリンクに送信する。 - 特許庁

A scheduler 202 monitors a signal in the module and supplies a power gating signal 218 used to eliminate power from at least either of a combination of a 1st header signal and a 1st payload signal and a combination of a 2nd header signal and a 2nd payload signal to the modulator 206 before amplification by the amplifier 210.例文帳に追加

スケジューラ２０２は、モジュール中の信号をモニタし、増幅器２１０による増幅の前に、第１ヘッダ信号及び第１ペイロード信号の組合せと、第２ヘッダ信号及び第２ペイロード信号の組合せの少なくとも一方から電力を除去するための電力ゲーティング信号２１８を変調器２０６に供給する。 - 特許庁

The design method for semiconductor integrated circuit comprises steps of (A) providing an operation model of the power gating circuit; (B) setting a restriction for rush current; (C) executing a circuit simulation using the operation model; and (D) generating timing data showing the ON timing for turning on each of the plurality of power supply switches based on the result of the circuit simulation.例文帳に追加

本発明に係る半導体集積回路の設計方法は、（Ａ）パワーゲーティング回路の動作モデルを提供するステップと、（Ｂ）突入電流に関する制約を設定するステップと、（Ｃ）動作モデルを用いた回路シミュレーションを実行するステップと、（Ｄ）回路シミュレーションの結果に基づいて、複数の電源スイッチのそれぞれをＯＮさせるＯＮタイミングを示すタイミングデータを生成するステップとを有する。 - 特許庁

例文

The power-gating technique for the integrated circuit device having the Sleep Mode of operation comprises providing an output stage (224) coupled between a supply voltage source and a reference voltage source and driving a gate terminal of at least one element of the output stage to a level above that of the supply voltage source or below that of the reference voltage source in the Sleep Mode of operation.例文帳に追加

スリープモード動作を有する集積回路装置のためのパワーゲーティング技術であって、供給電圧源と基準電圧源との間に結合される出力段（２２４）を設けることと、スリープモード動作において、出力段の少なくとも１つの素子のゲート端子を、前記供給電圧源のレベルよりも上の、または基準電圧源のレベルよりも下のレベルに駆動することとを含む。 - 特許庁

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